A continuación se enumeran numerosos ejemplos a escala de semiconductores para diversos nodos de proceso de fabricación de transistores de efecto de campo de metal-óxido-semiconductor (MOSFET o transistores MOS) .
Cronograma de demostraciones de MOSFET
PMOS y NMOS
CMOS (compuerta única)
MOSFET multigates (MuGFET)
Otros tipos de MOSFET
Productos comerciales que utilizan MOSFETs a microescala.
Productos con un proceso de fabricación de 20 μm
Productos con proceso de fabricación de 10 μm
- El Intel 4004 , el primer microprocesador de un solo chip (CPU) , se lanzó en 1971.
- El procesador Intel 8008 se lanzó en 1972.
Productos con proceso de fabricación de 8 μm
- Intel 1103 , un chip de memoria de acceso aleatorio dinámico (DRAM) de los primeros tiempos, lanzado en 1970. [ 94 ]
- La CPU MOS Technology 6502 de 1 MHz se lanzó en 1975. [ 95 ]
Productos fabricados mediante un proceso de 6 μm.
- Toshiba TLCS-12, un microprocesador desarrollado para el sistema Ford EEC (Control Electrónico del Motor) en 1973. [ 11 ]
- La CPU Intel 8080 , lanzada en 1974, se fabricó utilizando este proceso. [ 96 ]
- El adaptador de interfaz de televisión , el chip de gráficos y audio personalizado desarrollado para la Atari 2600 en 1977. [ 97 ]
- MOS Technology SID , un generador de sonido programable desarrollado para el Commodore 64 en 1982. [ 97 ]
- MOS Technology VIC-II , un controlador de pantalla de vídeo desarrollado para el Commodore 64 en 1982 (5 μm). [ 97 ]
Productos con proceso de fabricación de 3 μm
- La CPU Intel 8085 se lanzó en 1976. [ 98 ]
- La CPU Intel 8086 se lanzó en 1978. [ 96 ]
- El procesador Intel 8088 se lanzó en 1979.
- Procesador Motorola 68000 de 8 MHz, lanzado en 1979 (3,5 μm).
Productos con proceso de fabricación de 1,5 μm
- Chip de memoria SRAM de 64 kb de NEC en 1981. [ 47 ]
- El procesador Intel 80286 se lanzó en 1982.
- La arquitectura gráfica avanzada de Amiga (vendida inicialmente en 1992) incluía chips como Alice que se fabricaban utilizando un proceso CMOS de 1,5 μm . [ 99 ]
Productos con proceso de fabricación de 1 μm
- Los chips de memoria DRAM de NTT , incluyendo su chip de 64 kb en 1979 y el chip de 256 kb en 1980. [ 37 ]
- Chip de memoria DRAM de 1 Mb de NEC en 1984. [ 47 ]
- El procesador Intel 80386 se lanzó en 1985.
Productos fabricados mediante un proceso de 800 nm.
- Chip de memoria DRAM de 1 Mb de NTT en 1984. [ 37 ]
- NEC y Toshiba utilizaron este proceso para sus chips de memoria DRAM de 4 Mb en 1986. [ 47 ]
- Hitachi , IBM , Matsushita y Mitsubishi Electric utilizaron este proceso para sus chips de memoria DRAM de 4 Mb en 1987. [ 37 ]
- Chip de memoria EPROM de 4 Mb de Toshiba en 1987. [ 47 ]
- Hitachi, Mitsubishi y Toshiba utilizaron este proceso para sus chips de memoria SRAM de 1 Mb en 1987. [ 47 ]
- El procesador Intel 486 se lanzó en 1989.
- microSPARC I se lanzó en 1992.
- Los primeros procesadores Intel P5 Pentium de 60 MHz y 66 MHz se lanzaron en 1993.
Productos fabricados mediante un proceso de 600 nm.
- Mitsubishi Electric , Toshiba y NEC introdujeron chips de memoria DRAM de 16 Mb fabricados con un proceso de 600 nm en 1989. [ 47 ]
- Chip de memoria EPROM de 16 Mb de NEC en 1990. [ 47 ]
- Chip de memoria flash de 16 Mb de Mitsubishi en 1991. [ 47 ]
- El procesador Intel 80486DX4 se lanzó en 1994.
- El IBM / Motorola PowerPC 601 , el primer chip PowerPC, se fabricó con una tecnología de 0,6 μm.
- Procesadores Intel Pentium de 75 MHz, 90 MHz y 100 MHz.
Productos fabricados mediante un proceso de 350 nm.
- Chip de memoria SRAM de 16 Mb de Sony en 1994. [ 47 ]
- NEC VR4300 (1995), utilizado en la consola de videojuegos Nintendo 64 .
- Procesadores Intel Pentium Pro (1995), Pentium ( P54CS , 1995) y los primeros procesadores Pentium II ( Klamath , 1997).
- Procesadores AMD K5 (1996) y AMD K6 original (Modelo 6, 1997).
- Parallax Propeller , microcontrolador de 8 núcleos. [ 100 ]
Productos fabricados mediante un proceso de 250 nm.
- Chip de memoria SRAM de 16 Mb de Hitachi en 1993. [ 47 ]
- Hitachi y NEC introdujeron chips de memoria DRAM de 256 Mb fabricados con este proceso en 1993, seguidos por Matsushita , Mitsubishi Electric y Oki en 1994. [ 47 ]
- Chip de memoria DRAM de 1 Gb de NEC en 1995. [ 47 ]
- Chip de memoria flash NAND de 128 Mb de Hitachi en 1996. [ 47 ]
- DEC Alpha 21264A, que se comercializó a partir de 1999.
- AMD K6-2 Chomper y Chomper Extended . Chomper se lanzó el 28 de mayo de 1998.
- El procesador AMD K6-III "Sharptooth" utilizaba tecnología de 250 nm.
- Procesador móvil Pentium MMX Tillamook , lanzado en agosto de 1997.
- Pentium II Deschutes .
- La consola Dreamcast contaba con una CPU Hitachi SH-4 y una GPU PowerVR2 , lanzadas en 1998.
- Pentium III Katmai .
- CPU Emotion Engine inicial de PlayStation 2 .
Procesadores que utilizan tecnología de fabricación de 180 nm
- Intel Coppermine E - Octubre de 1999
- Motor de emociones y sintetizador de gráficos de la consola Sony PlayStation 2 – Marzo de 2000 [ 101 ]
- ATI Radeon R100 y RV100 Radeon 7000 – 2000
- AMD Athlon Thunderbird – Junio de 2000
- Intel Celeron (Willamette) – Mayo de 2002
- Motorola PowerPC 7445 y 7455 (Apollo 6) – enero de 2002
Procesadores que utilizan tecnología de fabricación de 130 nm
- Fujitsu SPARC64 V – 2001 [ 102 ]
- Gekko de IBM y Nintendo ( consola GameCube ) – 2001
- Motorola PowerPC 7447 y 7457 – 2002
- IBM PowerPC G5 970 – Octubre de 2002 – Junio de 2003
- Intel Pentium III Tualatin y Coppermine – 2001-04
- Intel Celeron Tualatin -256 – 2001-10-02
- Intel Pentium M Banias – 2003-03-12
- Intel Pentium 4 Northwood - 7 de enero de 2002
- Intel Celeron Northwood-128 – 18/09/2002
- Procesadores Intel Xeon Prestonia y Gallatin – 25/02/2002
- VÍA C3 – 2001
- AMD Athlon XP Thoroughbred, Thorton y Barton
- AMD Athlon MP Pura Sangre – 27/08/2002
- AMD Athlon XP-M Thoroughbred, Barton y Dublín
- AMD Duron Applebred – 21/08/2003
- AMD K7 Sempron Thoroughbred-B, Thorton y Barton – 28/07/2004
- AMD K8 Sempron París – 2004-07-28
- AMD Athlon 64 Clawhammer y Newcastle – 23/09/2003
- AMD Opteron Sledgehammer – 30/06/2003
- Elbrus 2000 1891ВМ4Я (1891VM4YA) – 27/04/2008
- MCST-R500S 1891BM3 – 2008-07-27
- Vortex 86SX –
Productos comerciales que utilizan MOSFETs a nanoescala.
Chips fabricados con tecnología de 90 nm
- Sony–Toshiba Emotion Engine + Sintetizador de gráficos ( PlayStation 2 ) – 2003 [ 101 ]
- IBM PowerPC G5 970FX – 2004
- Proceso de fabricación de memoria SDRAM DDR2 de 90 nm de Elpida Memory – 2005
- IBM PowerPC G5 970MP – 2005
- IBM PowerPC G5 970GX – 2005
- Procesador IBM Waternoose para Xbox 360 – 2005
- Procesador celular IBM–Sony–Toshiba – 2005
- Intel Pentium 4 Prescott – 2004-02
- Intel Celeron D Prescott-256 – 2004-05
- Intel Pentium M Dothan – 2004-05
- Intel Celeron M Dothan -1024 – 2004-08
- Intel Xeon Nocona, Irwindale, Cranford, Potomac, Paxville – 2004-06
- Procesador Intel Pentium D Smithfield – 2005-05
- AMD Athlon 64 Winchester, Venice, San Diego, Orleans – 2004-10
- AMD Athlon 64 X2 Manchester, Toledo, Windsor – 2005-05
- AMD Sempron Palermo y Manila – 2004-08
- AMD Turion 64 Lancaster y Richmond – 2005-03
- AMD Turion 64 X2 Taylor y Trinidad – 2006-05
- AMD Opteron Venus, Troy y Atenas – 2005-08
- AMD Dual-core Opteron Dinamarca, Italia, Egipto, Santa Ana y Santa Rosa
- VIA C7 – 2005-05
- Loongson (Ahijado) 2E STLS2E02 – 2007-04
- Loongson (Ahijado) 2F STLS2F02 – 2008-07
- MCST-4R – 2010-12
- Elbrus-2C+ – 2011-11
Procesadores que utilizan tecnología de fabricación de 65 nm
- Sony – Toshiba EE + GS ( PStwo ) [ 103 ] – 2005
- Intel Pentium 4 (Cedar Mill) – 16/01/2006
- Procesador Intel Pentium D serie 900 – 16/01/2006
- Intel Celeron D (núcleos Cedar Mill) – 28/05/2006
- Intel Core – 05/01/2006
- Intel Core 2 – 27/07/2006
- Intel Xeon ( Sossaman ) – 14/03/2006
- Serie AMD Athlon 64 (a partir de Lima) – 2007-02-20
- Serie AMD Turion 64 X2 (a partir de Tyler) – 7 de mayo de 2007
- Serie AMD Phenom
- Procesador Cell de IBM – PlayStation 3 – 17/11/2007
- El Z10 de IBM
- CPU "Falcon" de Microsoft Xbox 360 – 2007–09
- Procesador Microsoft Xbox 360 "Opus" – 2008
- Procesador Microsoft Xbox 360 "Jasper" – 2008–10
- GPU "Jasper" de Microsoft Xbox 360 – 2008–10
- Sun UltraSPARC T2 – 2007–10
- AMD Turion Ultra – 2008-06 [ 104 ]
- Familia TI OMAP 3 [ 105 ] – 2008-02
- VIA Nano – 2008-05
- Loongson – 2009
- GPU NVIDIA GeForce 8800GT – 2007
Procesadores que utilizan tecnología de 45 nm
- Matsushita lanzó el Uniphier de 45 nm en 2007. [ 106 ]
- Wolfdale , Yorkfield , Yorkfield XE y Penryn son núcleos de Intel que se venden bajo la marca Core 2 .
- Procesadores Intel Core i7 , i5 750 ( Lynnfield y Clarksfield )
- Los procesadores Pentium Dual-Core Wolfdale-3M son los procesadores de doble núcleo más populares de Intel que se venden actualmente bajo la marca Pentium .
- Diamondville y Pineview son núcleos Intel actuales con tecnología hyper-threading que se venden bajo la marca Intel Atom .
- Procesadores AMD Deneb ( Phenom II ) y Shanghai ( Opteron ) de cuatro núcleos, procesadores Regor ( Athlon II ) de doble núcleo, procesadores móviles de doble núcleo Caspian ( Turion II ).
- Procesador AMD ( Phenom II ) "Thuban" de seis núcleos (1055T)
- Xenón en el modelo Xbox 360 S.
- Motor de banda ancha celular Sony-Toshiba en el modelo PlayStation 3 Slim – septiembre de 2009.
- Samsung S5PC110, también conocido como Hummingbird .
- Texas Instruments OMAP 36xx.
- IBM POWER7 y z196
- Serie Fujitsu SPARC64 VIIIfx
- Espresso (microprocesador) CPU de Wii U
Chips que utilizan tecnología de 32 nm
- Toshiba produjo chips de memoria flash NAND comerciales de 32 Gb con el proceso de 32 nm en 2009. [ 107 ]
- Procesadores Intel Core i3 e i5, lanzados en enero de 2010 [ 108 ]
- Procesador Intel de 6 núcleos, con nombre en clave Gulftown [ 109 ]
- El procesador Intel i7-970 se lanzó a finales de julio de 2010, con un precio aproximado de 900 dólares estadounidenses.
- Los procesadores AMD FX Series, con nombre en clave Zambezi y basados en la arquitectura Bulldozer de AMD , se lanzaron en octubre de 2011. Esta tecnología utilizaba un proceso SOI de 32 nm, dos núcleos de CPU por módulo y hasta cuatro módulos, con precios que iban desde un diseño de cuatro núcleos con un coste aproximado de 130 dólares estadounidenses hasta un diseño de ocho núcleos con un coste de 280 dólares.
- Ambarella Inc. anunció la disponibilidad del circuito de sistema en un chip A7L para cámaras digitales, que proporciona capacidades de vídeo de alta definición 1080p60 en septiembre de 2011 [ 110 ].
Chips que utilizan tecnología de 24 a 28 nm
- SK Hynix anunció que podía producir un chip flash de 26 nm con una capacidad de 64 Gb; Intel Corp. y Micron Technology ya habían desarrollado la tecnología por su cuenta. Anunciado en 2010. [ 111 ]
- Toshiba anunció que estaba enviando dispositivos de memoria flash NAND de 24 nm el 31 de agosto de 2010. [ 112 ]
- En 2016, el procesador Elbrus-8S de 28 nm de MCST entró en producción en serie. [ 113 ] [ 114 ]
- Los chips A Series de AMD y muchos chips Athlon X4 posteriores basados en Steamroller y Excavator se basaron en gran medida en el nodo de proceso de 28 nm. [ 115 ] [ 116 ]
Chips que utilizan tecnología de 22 nm
- Los procesadores Intel Core i7 e Intel Core i5 basados en la tecnología Ivy Bridge de 22 nm de Intel para los conjuntos de chips de la serie 7 salieron a la venta en todo el mundo el 23 de abril de 2012. [ 117 ]
Chips que utilizan tecnología de 20 nm
- Samsung Electronics comenzó la producción en masa de chips de memoria flash NAND de 64 Gb utilizando un proceso de 20 nm en 2010. [ 118 ]
- Nvidia Tegra X1 ( Nintendo Switch y Nvidia Shield TV )
Chips que utilizan tecnología de 16 nm
- TSMC comenzó la producción de chips FinFET de 16 nm en 2013. [ 119 ]
- Nvidia Tegra X1+ (modelos posteriores para Nintendo Switch y Nvidia Shield TV )
Chips que utilizan tecnología de 14 nm
- Los procesadores Intel Core i7 e Intel Core i5 basados en la tecnología Broadwell de 14 nm de Intel se lanzaron en enero de 2015. [ 120 ]
- Procesadores AMD Ryzen basados en las arquitecturas Zen o Zen+ de AMD y que utilizan tecnología FinFET de 14 nm . [ 121 ]
Chips que utilizan tecnología de 10 nm
- Samsung anunció que había comenzado la producción en masa de chips de memoria flash de celda multinivel (MLC) utilizando un proceso de 10 nm en 2013. [ 122 ] El 17 de octubre de 2016, Samsung Electronics anunció la producción en masa de chips SoC a 10 nm. [ 123 ]
- TSMC comenzó la producción comercial de chips de 10 nm a principios de 2016, antes de pasar a la producción en masa a principios de 2017. [ 124 ]
- Samsung comenzó a enviar el teléfono inteligente Galaxy S8 en abril de 2017 utilizando el procesador de 10 nm de la compañía . [ 125 ]
- Apple lanzó en junio de 2017 las tabletas iPad Pro de segunda generación equipadas con chips Apple A10X fabricados por TSMC mediante el proceso FinFET de 10 nm. [ 126 ]
Chips que utilizan tecnología de 7 nm
- TSMC comenzó la producción de riesgo de chips de memoria SRAM de 256 Mbit utilizando un proceso de 7 nm en abril de 2017. [ 127 ]
- Samsung y TSMC comenzaron la producción en masa de dispositivos de 7 nm en 2018. [ 128 ]
- Los procesadores móviles Apple A12 y Huawei Kirin 980 , ambos lanzados en 2018, utilizan chips de 7 nm fabricados por TSMC. [ 129 ]
- AMD comenzó a utilizar TSMC 7 nm a partir de la GPU Vega 20 en noviembre de 2018, [ 130 ] con CPU y APU basadas en Zen 2 desde julio de 2019, [ 131 ] y para las APU de las consolas PlayStation 5 [ 132 ] y Xbox Series X/S [ 133 ] , lanzadas ambas en noviembre de 2020.
Chips que utilizan tecnología de 5 nm
Chips que utilizan tecnología de 3 nm
- TSMC ha anunciado planes para lanzar dispositivos de 3 nm durante 2021-2022. [ 136 ] [ 137 ]
- Samsung Electronics comenzó la producción de riesgo de transistores GAAFET de 3 nm en junio de 2022. [ 138 ]
- Apple A17 Pro ( iPhone 15 Pro )
Véase también
Referencias
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